计算机科学 ›› 2006, Vol. 33 ›› Issue (2): 97-99.

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基于FPGA的IPSec协议安全算法硬件单元设计

刘航 戴冠中 李晖晖 陈赞锋   

  1. 西北工业大学信息安全中心,西安710072
  • 出版日期:2018-11-17 发布日期:2018-11-17
  • 基金资助:
    国防基础研究项目(项目编号;J13008005).

LIU Hang ,DAI Guan-Zhong, LI Hui-Hui,CHEN Zan-Feng (Cyberspace Security Center, Northwestern Polytechnical University, Xi'an 710072)   

  • Online:2018-11-17 Published:2018-11-17

摘要: IPSec协议中的加解密、消息认证等安全算法的硬化实现可以显著改善关键网络设备的安全处理性能。本文采用现场可编程门阵列(FPGA)设计了一个包括AES、HMAC-SHA-1等安全算法及其替换算法的IPSec协议安全算法硬件单元。仿真结果表明,本文设计的安全算法硬件单元能显著地提高IPSec协议的处理速度。

关键词: 网际安全协议 现场可编程门阵列 高级加密标准 消息签名 安全散列算法

Abstract: The hardware-based implementation of the security algorithms, such as block cipher and message authentication, can effectively improve the security processing performance of the key network equipments. In this paper, a security algorithm hardware unit inc

Key words: Internet protocol security, Field programmable gate array, Advanced enerypt standard, Message authentication, Secure hash algorithm

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